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EDA技术 |
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请问如何用乘法器和加法器构成一个乘法累加器我得错在哪里呢？ | 物证 | 5 | 2024/3/5 5:46:33 |
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如何用VHDL实现这个简单的时序？ | bluefancy | 7 | 2024/3/5 5:06:40 |
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求教：体去藕电容（bulk cap)如何连接 | tianfeiyu | 3 | 2024/3/5 5:01:34 |
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关于ALTERA，CPLD的输出电压接口，请看这三张图， | bluefancy | 18 | 2024/3/5 4:15:59 |
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哪为好心人帮忙看看这个程序啊 顺便还问个分频程序的问题 | 84082379 | 15 | 2024/3/5 3:59:51 |
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毕业设计求助！！！ | lcy5559 | 5 | 2024/3/5 3:51:45 |
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高手帮我看看这个状态机设计（Verilog描述，序列检测） | daiduohao | 15 | 2024/3/5 3:27:39 |
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求助串口问题 | maguofeng0 | 2 | 2024/3/5 2:34:17 |
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求助：何为桶形移位寄存器，它与其它形式的有什么区别呢？ | ndjerry | 2 | 2024/3/5 2:21:46 |
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求助:求 频 率 计 设 计 资 料~~~~~~~~~~~！！！！ | ardang003 | 19 | 2024/3/5 2:13:38 |
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PLD难问题，不知所措 | hahahaluo | 3 | 2024/3/5 2:11:37 |
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请问,MAX-plusII和QuartusII4.2能不能同时用一个下载线? | 2_1_I_C | 5 | 2024/3/5 1:44:50 |
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流水线加法器中出现的问题 | proudpeo | 5 | 2024/3/5 1:42:48 |
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单片机 CPLD抗干扰比拼 | andrew_hot | 21 | 2024/3/5 1:33:15 |
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用VHDL写的一个比较器的程序，出现错误，请教大侠！ | 温柔的毒药 | 3 | 2024/3/5 0:32:39 |
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请问EP2C35F424北京能买到吗？ | kimjin | 2 | 2024/3/5 0:11:43 |
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vhdl中向port赋值后值会变化吗？ | hbsjzzx | 2 | 2024/3/5 0:08:24 |
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这个测试向量怎么写？ | limee | 3 | 2024/3/4 23:47:50 |
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关于延时! | chinawei97 | 3 | 2024/3/4 23:14:57 |
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Verilog内如何实现左移而不增加字长 | worminight | 3 | 2024/3/4 22:09:07 |
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看完ALTERA的AN224<<High Speed Board Layout Guidelines>>有 | bluefancy | 4 | 2024/3/4 21:02:39 |
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请教大虾－－orcad中Pspice的问题 | isabelshen | 6 | 2024/3/4 20:46:56 |
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请问如何在VERILOG里面实现次数可变的循环啊?(痛苦中) | wanderlust | 8 | 2024/3/4 20:42:29 |
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求问一个HDL的语法实现问题 | bbbaaa111 | 3 | 2024/3/4 18:26:46 |
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请问我的xc2s100为什么不能从flash中加载啊？ | 物证 | 5 | 2024/3/4 18:07:59 |
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VGA时序问题 | cpld163 | 5 | 2024/3/4 17:32:05 |
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我这里有免费的ise6.3和edk6.3，教育网内的同道可以来下载。 | xiaowenwen | 5 | 2024/3/4 16:22:34 |
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maxpluss II 程序下载 | rull | 5 | 2024/3/4 16:02:41 |
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Cadence Allegro 简介与安装方法 | pcbtech | 2 | 2024/3/4 15:53:42 |
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关于VHDL细节的讨论！！！ | suzhen_1 | 2 | 2024/3/4 15:34:12 |
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